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LTM4603HV
APPLICATIO S I FOR ATIO
CLOCK SYNC
V IN
V OUT
C5
0.01 μ F
4.5V TO 28V
R2
100k
R4
100k
V IN
PLLIN TRACK/SS
REVIEW TEMPERATURE
DERATING CURVE
V OUT
PGOOD
ON/OFF
PGOOD
MPGM
RUN
COMP
INTV CC
LTM4603HV
V OUT
V FB
MARG0
MARG1
V OUT_LCL
C3 100pF
MARGIN
CONTROL
C OUT1
22 μ F
6.3V
+
C OUT2
470 μ F
6.3V
1.5V
6A
C IN
BULK
OPT.
TABLE 2
+
C IN
10 μ F
35V
× 2 CER
R1
392k
DRV CC
SGND
PGND
DIFFV OUT
V OSNS+
V OSNS–
f SET
100k*
V IN
R SET
40.2k
REFER TO
TABLE 2
5% MARGIN
*100k NEEDED ONLY FOR
≥ 20V INPUT
4603 F18
Figure 20. Typical 4.5V-28V IN , 1.5V at 6A Design
V OUT
V IN
4.5V TO 28V
R9
118k
C3
0.1 μ F
LTC6908-1
V + OUT1
GND OUT2
SET MOD
C1
10 μ F
35V
× 2
R2
392k
R3
100k
C3
0.33 μ F
R4
100k
0 ° PHASE
V IN PLLIN
PGOOD V OUT
RUN V FB
COMP V OUT_LCL
INTV CC DIFFV OUT
LTM4603HV
DRV CC V OSNS+
MPGM V OSNS–
f SET MARG0
TRACK/SS MARG1
SGND PGND
C8
100pF
R SET
9.53k
MARGIN
CONTROL
C2
100 μ F
6.3V
C4
220 μ F
6.3V
V OUT
2.5V
12A
2-PHASE
OSCILLATOR
180 ° PHASE
C5
10 μ F
35V
× 2
R7
100k
R6
392k
V IN PLLIN
PGOOD V OUT
RUN V FB
COMP V OUT_LCL
INTV CC DIFFV OUT
LTM4603HV
V OSNS+
DRV CC
V OSNS–
MPGM
MARG0
f SET
TRACK/SS
MARG1
C7
100 μ F
6.3V
C6
220 μ F
6.3V
SGND
PGND
4603HV F21
5% MARGIN
Figure 21. 2-Phase, Parallel 2.5V at 12A Design
4603hvf
21
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